A hardware efficient 3-bit second-order dynamic element matching circuit clocked at 300MHz

International audienceA robust and hardware efficient dynamic element matching (DEM) algorithm is developed and used to design a 4th-order bandpass (BP) mismatch-shaping circuit, moved inside the feedback loop of a 6th-order bandpass continuous-time delta-sigma modulator. This algorithm is based on a shortened tree-structured scheme (STDEM) which can assure a stable high order mismatch-shaping with a modest circuit volume. The modulator has a 3-bit quantizer and 8 thermometric feedback DAC's cells. The designed DEM's circuits is simulated in 0.35μ- CMOS which can be clocked up to 300-MHz. The mismatch error floor is decreased of about 35dB in the band of interest. Its related circuit occupies of about 0.22mm2 area

Analyse et compensation des imperfections des blocs élémentaires d'un convertisseur modulateur sigma-delta à temps continu en technologie AsGa

La conception des modulateurs sigma-delta passe bande à temps continu, dédiés à la conversion analogique-numérique de signaux radiofréquences, se heurte à de nombreuses difficultés car les technologies sont utilisées aux limites de leurs possibilités. Les imperfections résultant de la réalisation au niveau circuit des blocs fonctionnels idéaux sont susceptibles de dégrader considérablement les performances. Cet article analyse l'influence de deux imperfections (les termes passe-bas des résonateurs à temps continus et la bande passante du sommateur) et propose des solutions de compensation génériques. A titre d'illustration, la démarche est mise en oeuvre pour la conception d'un modulateur d'ordre 6 prévu pour fonctionner à une fréquence de sur-échantillonnage de 3 GHz, pour une fréquence centrale de 750 MHz et une largeur de bande d'environ 10 MHz. Des résultats obtenus par simulation au niveau transistor en technologie AsGa HEMT 0.2, sont présentés