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    A 6-bit 2GS/s CMOS Time-Interleaved ADC for Analysis of Mixed-Signal Calibration Techniques

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    A 6-bit 2-GS/s time interleaved (TI) successive approximation register (SAR) analog-to-digital converter (ADC) is designed and fabricated in a 0.13 渭m CMOS process. The architecture uses 8 time-interleaved track-and-hold amplifiers (THA), and 16 SARADC鈥檚. Thechipincludes (i) a programmable delay cell array to adjust the interleaved sampling phase, and (ii) a 12 Gbps low voltage differential signaling (LVDS) interface. These blocks make the fabricated ADC an excellent platform to evaluate mixed-signal calibration techniques, which are of great interest for application in high-speed optical systems. Measurements of the fabricated ADC show 33.9 dB of peak signal-to-noise-and-distortion ratio (SNDR) and 192 mW of power consumption at 1.2 Vhttp://ieeexplore.ieee.org/stamp/stamp.jsp?arnumber=6820267Fil: Reyes, Benjam铆n. Universidad Nacional de C贸rdoba. Facultad de Ciencias Exactas, F铆sicas y Naturales; Argentina.Fil: Tealdi, Lucas. Fundaci贸n Fulgor; Argentina.Fil: Paulina, German. Fundaci贸n Fulgor; Argentina.Fil: Labat, Emanuel. Fundaci贸n Fulgor; Argentina.Fil: S谩nchez, Ra煤l. Fundaci贸n Fulgor; Argentina.Fil: Mandolesi, Pablo. Universidad Nacional del Sur. Grupo de Investigaci贸n en Sistemas Electr贸nicos y Electromecatr贸nicos (GISEE). Laboratorio de Micro y Nano Electr贸nica (LMNE); Argentina.Fil: Hueda, Mario. Universidad Nacional de C贸rdoba. Consejo Nacional de Investigaciones Cient铆ficas y T茅cnicas. Laboratorio de Comunicaciones Digitales; Argentina.Fil: Reyes, Benjam铆n. Consejo Nacional de Investigaciones Cient铆ficas y T茅cnicas. Laboratorio de Comunicaciones Digitales; Argentina.Telecomunicacione

    Generaci贸n y calibraci贸n de se帽ales de reloj para conversores anal贸gico-digital de tiempo entrelazado

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    Proyecto Integrador (IE)--FCEFN-UNC, 2018Trata el dise帽o, implementaci贸n y verificaci贸n de los bloques encargados de la generaci贸n y calibraci贸n de las fases de muestreo de un TI-ADC (conversor anal贸gico digital de tiempo entrelazado
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